ST: Perl Package for Simulation and Test
STは, ディジタルLSIのシミュレーションとテストのためのPerlパッケージで す. perlを使って回路の入力ベクタと期待値を書くことにより, Verilogや SPICEといった論理レベルから回路レベルのシミュレータまでのテストベンチ を生成することができます.
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2000年VDEC LSIデザイナーズフォーラムでの 発表資料(PDF)
2000/09/26@宮島
Last modified: Sun Aug 27 09:36:12 JST 2023